ddr3/4时序仿真分析

日期:2018-05-26 / 人气: / 来源:www.shenqiufangchan.com

仿真要求和仿真列表

序号

关键信号种类

关键型号类型

ddr3

clock与addr/cmd/ctrl信号之间的时序关系

clock信号频率为667mhz,

addr/cmd/ctrl信号数据率

为667mbps

dqs与dq读时序

dqs信号频率为667mhz,

dq信号的数据率为1333mbps

dqs与dq写时序

2. 模型及参考文件

文件/器件

模型/文件

备注

pcb文件

xxxx.brd

设计文件

芯片模型

主控芯片  xxxx.ibs

厂家提供

ddr3芯片 v69a.ibs

规范标准

jesd79-3e

 

3. 仿真结果及建议  

信号名称

建立时间裕量

保持时间裕量

结果

clock与addr/cmd/ctrl信号时序

174ps

224ps

pass

dqs与dq读时序

202ps

237ps

pass

dqs与dq写时序

49.5ps

49.5ps

pass

4. 时序计算基本原理  

5. 时序分析方法和内容

6. 实际pcb中信号的拓扑结构与连接方式

fanzhenshixu

7. 地址线、命令线、控制线与时钟之间的时序计算

8. dqs与dq的时序计算(写操作)

9. dqs与dq的时序计算(读操作)

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作者:电子产品设计


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